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電路方案

xilinx ddr3
Xilinx Spartan 6的DDR3原理圖+用戶手冊(cè)

feilg

2016/08/08

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文章

Xilinx PCIe高速接口入門實(shí)戰(zhàn)（四）
本文介紹PCIe IP核時(shí)鐘結(jié)構(gòu)、PCIe板卡時(shí)鐘方案及復(fù)位設(shè)計(jì)相關(guān)內(nèi)容。集成塊輸入系統(tǒng)時(shí)鐘信號(hào)稱為sys_clk，該時(shí)鐘頻率必須為100MHz、125MHz或250MHz。使用的時(shí)鐘頻率必須與Vivado IDE中的時(shí)鐘頻率選擇相匹配。

FPGA技術(shù)實(shí)戰(zhàn)

3986

01/02 12:50

PCIE xilinx
Xilinx PCIe高速接口入門實(shí)戰(zhàn)（三）
為保證FPGA設(shè)備可以連接并被系統(tǒng)識(shí)別，本節(jié)討論了PCIe基礎(chǔ)規(guī)范和PCIe板卡電氣規(guī)范的對(duì)FPGA配置時(shí)間具體要求。在PCIe的標(biāo)準(zhǔn)系統(tǒng)中，當(dāng)系統(tǒng)通電時(shí)，處理器上運(yùn)行的配置軟件開(kāi)始掃描PCIe總線以發(fā)現(xiàn)機(jī)器拓?fù)洹呙鑀CIe層次結(jié)構(gòu)以確定其拓?fù)浣Y(jié)構(gòu)的過(guò)程稱為枚舉過(guò)程，根復(fù)合體（RC）通過(guò)向設(shè)備發(fā)起配置事務(wù)來(lái)實(shí)現(xiàn)枚舉過(guò)程。?

FPGA技術(shù)實(shí)戰(zhàn)

3854

2024/12/31

PCIE xilinx
Xilinx PCIe高速接口入門實(shí)戰(zhàn)（二）
本文詳細(xì)介紹7 Series Intergrated Block for PCI ExpressPCIe硬核IP接口功能描述及PCIe配置空間相關(guān)內(nèi)容。

FPGA技術(shù)實(shí)戰(zhàn)

1955

2024/12/06

PCIE xilinx
Xilinx PCIe高速接口入門實(shí)戰(zhàn)（一）
本文對(duì)Xilinx 7 Series Intergrated Block for PCI Express PCIe硬核IP進(jìn)行簡(jiǎn)要介紹，主要包括7系列FPGA PCIe硬核資源支持、三IP硬核差異、PCIe硬核資源利用等相關(guān)內(nèi)容。

FPGA技術(shù)實(shí)戰(zhàn)

7849

2024/11/29

PCIE xilinx
后摩爾時(shí)代的創(chuàng)新：在米爾FPGA上實(shí)現(xiàn)Tiny YOLO V4，助力AIoT應(yīng)用
在全球半導(dǎo)體制程限制和高端 GPU 受限的大環(huán)境下，F(xiàn)PGA 成為了中國(guó)企業(yè)發(fā)展的重要路徑之一。它可支持靈活的 AIoT 應(yīng)用，其靈活性與可編程性使其可以在國(guó)內(nèi)成熟的 28nm 工藝甚至更低節(jié)點(diǎn)的制程下實(shí)現(xiàn)高效的硬件加速。

米爾電子

1223

2024/11/21

FPGA AIoT

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