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  • 從0到1設(shè)計(jì)BUCK(1) | BUCK設(shè)計(jì)流程，從需求定義到PCB布局的九大核心步驟
    先問(wèn)大家一個(gè)問(wèn)題：你知道降壓轉(zhuǎn)換器電路設(shè)計(jì)的第一步是什么嗎？如果一個(gè)電源工程師無(wú)法明確這點(diǎn)，那將是非常遺憾的。接下來(lái)，我們看下AI是怎么回答的，它是知道第一步是什么的。
    從0到1設(shè)計(jì)BUCK(1) | BUCK設(shè)計(jì)流程，從需求定義到PCB布局的九大核心步驟
  • 應(yīng)用指南導(dǎo)讀 | 優(yōu)化HV CoolGaN?功率晶體管的PCB布局
    作為寬禁帶半導(dǎo)體，氮化鎵（GaN）以其前所未有的速度、效率和可靠性迅速成為現(xiàn)代功率電子領(lǐng)域的新寵。然而，GaN器件的高速開(kāi)關(guān)行為也對(duì)PCB布局設(shè)計(jì)提出了巨大挑戰(zhàn)。因此想要充分發(fā)揮GaN的潛力，我們必須理解和管理PCB布局產(chǎn)生的寄生阻抗，確保電路正常、可靠地運(yùn)行，并且不會(huì)引起不必要的電磁干擾（EMI）。
  • 如何優(yōu)化開(kāi)關(guān)電源的效率？
    對(duì)于功率轉(zhuǎn)換器，寄生參數(shù)最小的熱回路PCB布局能夠改善能效比，降低電壓振鈴，并減少電磁干擾(EMI)。本文討論如何通過(guò)最小化PCB的等效串聯(lián)電阻(ESR)和等效串聯(lián)電感(ESL)來(lái)優(yōu)化熱回路布局設(shè)計(jì)。本文研究并比較了影響因素，包括解耦電容位置、功率FET尺寸和位置以及過(guò)孔布置。通過(guò)實(shí)驗(yàn)驗(yàn)證了分析結(jié)果，并總結(jié)了最小化PCB ESR和ESL的有效方法。
    如何優(yōu)化開(kāi)關(guān)電源的效率？
  • 如何區(qū)分模擬地和數(shù)字地？電路設(shè)計(jì)之在PCB布局中正確設(shè)置地線
    什么是接地？所謂接地其實(shí)就是系統(tǒng)中所有信號(hào)的參考點(diǎn)。理想情況下，地線上只有零伏的電勢(shì)。但是在現(xiàn)實(shí)世界中，所謂地平面其實(shí)就是具有一定阻抗能力的導(dǎo)體所承載的信號(hào)。
    如何區(qū)分模擬地和數(shù)字地？電路設(shè)計(jì)之在PCB布局中正確設(shè)置地線
  • USB2.0與USB3.0接口的PCB布局布線要求
    USB是通用串行總線的英文縮寫(xiě)，是連接外部裝置的一個(gè)串口總線標(biāo)準(zhǔn)，也是一種輸入輸出接口的技術(shù)規(guī)范，被廣泛地應(yīng)用于個(gè)人電腦和移動(dòng)設(shè)備等信息通迅產(chǎn)品，并擴(kuò)展到攝影器材，數(shù)字電視（機(jī)頂盒）、游戲機(jī)等其它相關(guān)領(lǐng)域。
    1.5萬(wàn)
    2024/08/17
  • 學(xué)廢晶振系列最終章：晶振電路常見(jiàn)問(wèn)題分析以及PCB布局講解
    關(guān)于晶振電路的選型計(jì)算，計(jì)劃用3篇文章詳細(xì)講解，這是三篇文章的最后一篇，前兩篇文章分享了晶振的類(lèi)型，負(fù)載電容的選型，晶振和MCU匹配度的計(jì)算方法，作為晶振系列文章的最后一篇，本篇文章會(huì)著重介紹一下晶振的常見(jiàn)問(wèn)題原因分析，還有就是比較重要的PCB布局講解。
    學(xué)廢晶振系列最終章：晶振電路常見(jiàn)問(wèn)題分析以及PCB布局講解
  • 干貨！PCB布局&布線九大最全要點(diǎn)~
    使用EDA設(shè)計(jì)時(shí)，首先進(jìn)行PCB的規(guī)則設(shè)置，一般規(guī)則設(shè)置比較重要的有間距設(shè)置、物理規(guī)則、平面規(guī)則、網(wǎng)絡(luò)設(shè)置。分別展示立創(chuàng)EDA和Allegro的規(guī)則設(shè)置界面。
    干貨！PCB布局&布線九大最全要點(diǎn)~
  • 全網(wǎng)獨(dú)家！射頻干擾去噪與單點(diǎn)地PCB布局分析！
    最近有個(gè)微弱信號(hào)放大采集項(xiàng)目，其實(shí)項(xiàng)目本身并不難，但是變態(tài)的地方在于應(yīng)用環(huán)境中有強(qiáng)輻射干擾，如果不加處理，會(huì)嚴(yán)重影響系統(tǒng)性能。常規(guī)的金屬屏蔽已經(jīng)不能完全解決問(wèn)題了，長(zhǎng)導(dǎo)聯(lián)線會(huì)有天線效應(yīng)，吸收強(qiáng)輻射干擾，進(jìn)而被儀表放大器采集到，在輸出端以噪聲形式出現(xiàn)。
    全網(wǎng)獨(dú)家！射頻干擾去噪與單點(diǎn)地PCB布局分析！
  • Altium Designer 23全新功能-使用Section View功能查看剖視圖
    為了更好的察看以及展示PCB的布局和結(jié)構(gòu)，Altium Designer 23（23.5以上版本）在PCB編輯器中添加了Section View功能。Section View功能可以通過(guò)在3維模式中設(shè)置對(duì)應(yīng)參數(shù)，從而達(dá)到更佳的展示出PCB 3D狀態(tài)中細(xì)節(jié)元素的目的。這些細(xì)節(jié)元素在PCB中以3D形式顯示時(shí)通常是不可見(jiàn)的，例如當(dāng)較小的SMD組件放置在較大的組件或機(jī)械部件下時(shí)，這可能會(huì)使組件移動(dòng)以及距離測(cè)量等操作變得困難。
    Altium Designer 23全新功能-使用Section View功能查看剖視圖
  • PCB布局的關(guān)鍵：SW節(jié)點(diǎn)的電場(chǎng)和磁場(chǎng)？| 深圳比創(chuàng)達(dá)EMC（4）
    本文將介紹最基本的開(kāi)關(guān)節(jié)點(diǎn)波形，助您了解如何在PCB路由時(shí)確定適當(dāng)?shù)拈_(kāi)關(guān)（SW）節(jié)點(diǎn)走線尺寸，并了解開(kāi)關(guān)節(jié)點(diǎn)中電場(chǎng)（E場(chǎng)）和磁場(chǎng)（H場(chǎng)）產(chǎn)生的近場(chǎng)耦合效應(yīng)。
  • PCB布局的關(guān)鍵：開(kāi)關(guān)節(jié)點(diǎn)走線尺寸滿(mǎn)足電流？| 深圳比創(chuàng)達(dá)EMC（3）
    本文將介紹最基本的開(kāi)關(guān)節(jié)點(diǎn)波形，助您了解如何在PCB路由時(shí)確定適當(dāng)?shù)拈_(kāi)關(guān)（SW）節(jié)點(diǎn)走線尺寸，并了解開(kāi)關(guān)節(jié)點(diǎn)中電場(chǎng)（E場(chǎng)）和磁場(chǎng)（H場(chǎng)）產(chǎn)生的近場(chǎng)耦合效應(yīng)。
  • WIFI與BT的PCB布局布線注意事項(xiàng)
    1、模塊整體布局時(shí)，WIFI模組要盡量遠(yuǎn)離DDR、HDMI、USB、LCD電路以及喇叭等易干擾模塊或連接座；2、晶體電路布局需要優(yōu)先考慮，布局時(shí)應(yīng)與芯片在同一層并盡量靠近放置以避免打過(guò)孔，晶體走線盡可能的短，遠(yuǎn)離干擾源，盡量天線區(qū)域；晶體以及時(shí)鐘信號(hào)需要全程包地處理，包地線每隔100mil至少添加一個(gè)GND過(guò)孔，并且必須保證鄰層的地參考面完整，如圖1所示。
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    2023/08/31
    WIFI與BT的PCB布局布線注意事項(xiàng)
  • PCB布局的關(guān)鍵：盡量縮短開(kāi)關(guān)節(jié)點(diǎn)走線長(zhǎng)度？| 深圳比創(chuàng)達(dá)EMC（2）
    開(kāi)關(guān)穩(wěn)壓器或功率變換器電路的開(kāi)關(guān)節(jié)點(diǎn)是關(guān)鍵的傳導(dǎo)路徑，在進(jìn)行PCB布局時(shí)需要特別注意。該電路節(jié)點(diǎn)將一個(gè)或多個(gè)功率半導(dǎo)體開(kāi)關(guān)（例如MOSFET或二極管）連接到磁能存儲(chǔ)設(shè)備（例如電感或變壓器繞組），其開(kāi)關(guān)信號(hào)包含了快速切換的dV/dt電壓和dI/dt電流，它們很容易耦合到周?chē)碾娐飞喜a(chǎn)生噪聲問(wèn)題，可能導(dǎo)致PCB和系統(tǒng)無(wú)法滿(mǎn)足嚴(yán)格的電磁兼容性（EMC）要求。
    1931
    2023/08/30
  • PCB布局的關(guān)鍵：開(kāi)關(guān)節(jié)點(diǎn)波形？|深圳比創(chuàng)達(dá)EMC（1）
    PCB布局的關(guān)鍵：開(kāi)關(guān)節(jié)點(diǎn)波形？相信不少人是有疑問(wèn)的，今天深圳市比創(chuàng)達(dá)電子科技有限公司就跟大家解答一下！本文將介紹最基本的開(kāi)關(guān)節(jié)點(diǎn)波形，助您了解如何在PCB路由時(shí)確定適當(dāng)?shù)拈_(kāi)關(guān)（SW）節(jié)點(diǎn)走線尺寸，并了解開(kāi)關(guān)節(jié)點(diǎn)中電場(chǎng)（E場(chǎng)）和磁場(chǎng)（H場(chǎng)）產(chǎn)生的近場(chǎng)耦合效應(yīng)。
  • SATA3.0接口的PCB布局布線要求
    SATA是serial ATA縮寫(xiě)，即串行ATA。它是一種電腦總線，主要功能是用于主板和大量存儲(chǔ)設(shè)備（如硬盤(pán)即光盤(pán)驅(qū)動(dòng)器）之間的數(shù)據(jù)傳輸。SATA3.0可在存儲(chǔ)單元、磁盤(pán)驅(qū)動(dòng)器、光學(xué)和磁帶驅(qū)動(dòng)器、主機(jī)總線適配器(HBA)之間提供理論最高6Gbps(750MB/s)速度的鏈路速度，對(duì)PCB設(shè)計(jì)提出了新的設(shè)計(jì)要求。SATA 3.0的接口定義如表1所示。
    SATA3.0接口的PCB布局布線要求
  • PCIe接口的PCB布局布線要求
    PCI-Express，簡(jiǎn)稱(chēng)“PCI-e”是一種高速串行計(jì)算機(jī)擴(kuò)展總線標(biāo)準(zhǔn)，PCI-E屬于高速串行點(diǎn)對(duì)點(diǎn)雙通道高帶寬傳輸，所連接的設(shè)備分配獨(dú)享通道帶寬，不共享總線帶寬，它的主要優(yōu)勢(shì)就是數(shù)據(jù)傳輸速率高。
  • DP1.4接口的PCB布局布線要求
    DP接口即為DisplayPort接口，是由視頻電子標(biāo)準(zhǔn)協(xié)會(huì)發(fā)布的顯示接口。DP接口將在傳輸視頻信號(hào)的同時(shí)加入對(duì)高清音頻信號(hào)傳輸?shù)闹С?，并且同時(shí)支持更高的分辨率以及刷新率。DP1.4通信端口規(guī)范新標(biāo)準(zhǔn)基于DP1.3規(guī)范，寬度不變但加入了顯示壓縮流技術(shù)，前向錯(cuò)誤更正，高動(dòng)態(tài)范圍數(shù)據(jù)包等。
    DP1.4接口的PCB布局布線要求
  • 如何布局出一個(gè)符合可制造性的PCB布局
    滿(mǎn)足可制造性、可裝配性、可維修性要求，方便調(diào)試的時(shí)候于檢測(cè)和返修，能夠方便的拆卸器件：
    1161
    2023/07/20
    如何布局出一個(gè)符合可制造性的PCB布局
  • 混合信號(hào)PCB布局設(shè)計(jì)的基本準(zhǔn)則
    摘要 本文詳細(xì)說(shuō)明在設(shè)計(jì)混合信號(hào)PCB的布局時(shí)應(yīng)考慮的內(nèi)容。本文將涉及元件放置、電路板分層和接地平面方面的考量。本文討論的準(zhǔn)則為混合信號(hào)板的布局設(shè)計(jì)提供了一種實(shí)用方法，對(duì)所有背景的工程師應(yīng)當(dāng)都能有所幫助。 簡(jiǎn)介 混合信號(hào)PCB設(shè)計(jì)要求對(duì)模擬和數(shù)字電路有基本的了解，以最大程度地減少（如果不能防止的話）信號(hào)干擾。構(gòu)成現(xiàn)代系統(tǒng)的元件既有在數(shù)字域運(yùn)行的元件，又有在模擬域運(yùn)行的元件，必須精心設(shè)計(jì)以確保整個(gè)系

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