FPGA常見IP（FIFO，ddr3，qdrII +，aurora）的使用及設(shè)計技巧

課程簡介：

本課程針對FPGA中常用IP核，如FIFO，ddr3 controller，qdrII+ controller，aurora，RapidIO Gen2等在使用設(shè)計過程中遇到的問題和技巧進行歸納總結(jié)。內(nèi)容包括：Verilog Coding過程常見的錯誤；ISE中將代碼封裝成IP核的方法；Standard FIFO和FWFT FIFO的應(yīng)用比較；設(shè)計DDR3 SDRAM 控制器和QDRII+ SRAM控制器的注意事項；Aurora協(xié)議的關(guān)鍵技術(shù)；RapidIO Gen2 IP核開發(fā)例程。

注：成功購買該課程后，可以在課程學(xué)習(xí)頁面免費下載《基于FPGA的數(shù)字信號處理(第2版)》電子書（第一小節(jié)）