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【新品速遞】一文詳解 ALINX NVMe IP 特性

2024/11/14
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- ALINX NVMe?IP -

在當(dāng)下數(shù)據(jù)驅(qū)動(dòng)的時(shí)代，企業(yè)對(duì)高性能存儲(chǔ)解決方案的需求不斷增加。NVMe AXI IP 憑借其支持大數(shù)據(jù)量、高速傳輸、低延遲等存儲(chǔ)性能優(yōu)勢(shì)，成為眾多開發(fā)者和企業(yè)的理想選擇。

NVMe?專為 SSD 而生，通過直接利用 PCIe 通道，避免 SATA 協(xié)議和外置控制器（PCH）的額外延遲，使性能大幅提升，尤其在隨機(jī) I/O 操作中表現(xiàn)突出。

NVMe PCIe SSD?的 IOPs 性能可達(dá)高端企業(yè)級(jí) SATA SSD 的十倍（具體場(chǎng)景為高隊(duì)列深度的隨機(jī)讀寫），同時(shí)支持自動(dòng)功耗狀態(tài)切換和動(dòng)態(tài)能耗管理功能，顯著降低功耗。

( NVMe/SAS/SATA 存儲(chǔ)設(shè)備單讀性能對(duì)比)

NVMe 協(xié)議憑借其高速傳輸、低延遲、高效能存儲(chǔ)和高可靠性的特點(diǎn)，在數(shù)據(jù)中心、邊緣計(jì)算、企業(yè)存儲(chǔ)、AI 服務(wù)器和云計(jì)算等領(lǐng)域有著廣泛應(yīng)用。

ALINX NVMe IP 詳情

ALINX NVMe IP 針對(duì)當(dāng)前數(shù)據(jù)密集型應(yīng)用進(jìn)行了深度優(yōu)化，顯著縮短了延遲時(shí)間，提升數(shù)據(jù)吞吐量，滿足云計(jì)算、大數(shù)據(jù)分析、人工智能、虛擬現(xiàn)實(shí)/增強(qiáng)現(xiàn)實(shí)( VR/AR )等前沿領(lǐng)域的迫切需求。

兼容性方面，NVMe IP 不依賴 CPU，全部由 FPGA 完成處理，需要 FPGA 具有足夠的資源和適當(dāng)?shù)?a class="article-link" target="_blank" href="/tag/%E7%A1%AC%E4%BB%B6/">硬件支持。ALINX NVMe IP 目前支持?AMD Virtex 7/ AMD UltraScale/AMD UltraScale+?系列器件。

技術(shù)支持方面，ALINX 提供完善的技術(shù)支持和高效的定制化服務(wù)，由經(jīng)驗(yàn)豐富的 IP 研發(fā)團(tuán)隊(duì)專人對(duì)接，全程協(xié)助客戶完成 IP 集成和性能優(yōu)化，確?？蛻粜枨罂焖賹?shí)現(xiàn)。

考慮到每個(gè)應(yīng)用場(chǎng)景都有其獨(dú)特需求，ALINX NVMe AXI IP 為開發(fā)者提供了豐富的定制選項(xiàng)，允許根據(jù)特定的應(yīng)用需求對(duì)其性能進(jìn)行精準(zhǔn)調(diào)整，包括不限于優(yōu)化特定工作負(fù)載下的數(shù)據(jù)傳輸速率，根據(jù)不同的存儲(chǔ)容量需求進(jìn)行配置等。

以下是 ALINX NVMe IP 的詳細(xì)介紹：

IP 資源消耗表

注：IP 實(shí)際邏輯資源消耗受實(shí)例化中其他邏輯資源消耗影響

產(chǎn)品特性

  • 功能支持：命令支持（Identify、Write、Read、Flush），兼容 NVMe 1.4 協(xié)議，支持 PCIe Gen 1.0-4.0；
  • 性能參數(shù)：

    （1）?最大隊(duì)列深度：每個(gè)隊(duì)列支持 65535 個(gè) I/O 命令；

    （2）?傳輸速率：基于 PCIe 3.0 X4，讀寫速率均可達(dá) 3000MB/s；

  • 靈活性：支持多種存儲(chǔ)單元（512 字節(jié) / 4096 字節(jié)）；
  • 支持定制化服務(wù)：包括數(shù)據(jù)傳輸速率優(yōu)化和存儲(chǔ)容量配置；
  • 版本支持：支持兩個(gè)版本（AXI FULL 版本 / AXI Stream 版本）；
  • 參考設(shè)計(jì)：XCZU19EG + FMC子板(FH1402)+SAMSUNG 980 M.2 SSD。
  • AXI-Master-FULL 版本
  • AXI-Stream 版本
NVMe AXI IP 應(yīng)用交互

NVMe AXI IP 通過 PCIe Bridge 實(shí)現(xiàn) PCIe 協(xié)議交互，支持 AXI FULL 和 AXI Stream 兩種接口模式。用戶數(shù)據(jù)通過 AXI Interconnect 接入后，經(jīng)過 NVMe AXI IP 的協(xié)議邏輯處理，被打包為 PCIe TLP 包并寫入 NVMe SSD 存儲(chǔ)；同樣，數(shù)據(jù)從 NVMe SSD 提取后，通過協(xié)議解析和 AXI 接口傳遞到上層邏輯。

Example 舉例

  • AXI-Master-FULL 版本
AXI 讀寫：在系統(tǒng)正常啟動(dòng)后，NVMe AXI IP 自動(dòng)初始化并建立 PCIe 鏈路連接。初始化完成后，用戶的數(shù)據(jù)流通過 AXI Interconnect IP 傳送到 NVMe AXI IP 的 AXI Master FULL 接口，進(jìn)行 NVMe 協(xié)議的處理。數(shù)據(jù)被打包為 TLP 層 PCIe 包，并通過 RC/RQ/CC/CQ AXI Stream 接口與 AMD UltraScale+ 設(shè)備的 PCIe 集成模塊（Integrated Block for PCIExpress）連接，最終寫入 NVMe SSD 存儲(chǔ)。當(dāng)需要讀取數(shù)據(jù)時(shí)，NVMe AXI IP 從 NVMe SSD 通過 RC/RQ/CC/CQ AXI Stream 接口提取數(shù)據(jù)，再通過 AXI Master FULL 接口與 AXI Interconnect IP 連接，將數(shù)據(jù)傳輸?shù)狡渌?AXI 總線接口供用戶邏輯使用。

  • AXI-Stream 版本
AXI Stream 讀寫：在系統(tǒng)正常啟動(dòng)后，NVMe AXI IP 自動(dòng)進(jìn)行初始化并建立連接。初始化完成后，用戶的數(shù)據(jù)流通過 AXI Stream 接口輸入到 NVMe AXI IP，執(zhí)行 NVMe 協(xié)議的交互處理。數(shù)據(jù)被打包為 TLP 層 PCIe 包，通過 RC/RQ/CC/CQ AXI Stream 接口與 AMD UltraScale+ 設(shè)備的 PCIe 集成模塊連接，最終存儲(chǔ)到 NVMe SSD。當(dāng)從 NVMe SSD 讀取數(shù)據(jù)時(shí)，NVMe AXI IP 使用 RC/RQ/CC/CQ AXI Stream 接口提取數(shù)據(jù)，并通過 AXI Stream 接口傳輸給連接的視頻輸出 IP，進(jìn)而通過視頻接口進(jìn)行數(shù)據(jù)展示。

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